【FPGA】浙江大华_笔试面试题目分享

简介: 【FPGA】浙江大华_笔试面试题目分享

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笔试

主要考察的c语言,fpga,数电,知识点包括看真值表画电路图,画状态图写fpga程序,三目运算符与选择器比,哪一个使用的资源多,c语言考察联合变量,指针变量等内容。


一面

讲解一个跟FPGA相关的项目经历,直接上板的内容,fpga上板的经历

你所设计的同步fifo异步fifo跟资料里面的设计有什么差异

你所使用的quartus指定的器件是什么

数码管显示,是用什么去显示的,特殊编码,数码管用什么编码,数据转换,led安克码,指定器件


fpga资源包括什么?

lut,DFF,dsp,ram,布局布线,io接口等等


ram的资源有哪几类?:

块ram,分布式ram 块ram和分布式ram,bram是fpga中定制的ram资源,dram就是用逻辑单元拼出来的


触发器,锁存器的区别

代码编写如何避免锁存器

描述一下三段式状态机

其中三段式状态机的第三段能用组合逻辑吗

格雷码编码的特点

亚稳态产生的根本原因

亚稳态能完美消除吗?

如何降低亚稳态发生的概率,有一个公式


亚稳态发生的概率=(建立时间+保持时间)/时钟周期

降低亚稳态的方法:

1.增大时钟周期

2.换性能更好的工艺,更小的setup time和hold time


setup time hole time 除以频率 周期除以周期

使用更快的器件

单bit跨时钟域,有什么需要注意的

懂得怎么看手册,怎么看协议

希望能把iot ram 分布式搞清楚,实现方法实现步骤理清楚


二面

基本的验证单元

mailbox 数据类型

异步fifo的原理

空满信号怎么产生的

格雷码为什么跨时钟域不会出现错误

格雷码出错会是什么样子,单bit采到沿上,采5采6,采到5采到6的快慢有变化,5556,5566,

fpga里面最基本的逻辑单元,

logic elemnet,四输入的查找表和寄存器外加进位链


HR面

籍贯,父母做什么,家里有无兄弟姐妹,最困难的时候,怎么克服,父母对成长的帮助,留学经历的帮助等

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