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全栈开发，了解FPGA，熟练OpenCV，熟悉安卓客户端和微信小程序开发。熟悉Python和Java后端研发。对新技术感兴趣。曾就职于百度、搜狗、蚂蚁金服 现就职于阿里。
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发表了文章 2024-06-11
通俗讲解 初学者一文看懂！虚函数、函数重载、重写的区别
函数重载允许在同一作用域内定义同名但参数列表不同的函数，提高代码灵活性和可读性，避免命名冲突。通过参数类型自动选择合适版本，如C++中的`print()`可处理整数、浮点数和字符串。虚函数实现运行时多态，基类指针调用时调用实际对象的版本。抽象类至少有一个纯虚函数，不能实例化，用于定义接口规范。抽象类和纯虚函数是构建多态和继承体系的基础，提供接口标准，减少代码冗余，增强代码清晰性和可维护性。
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发表了文章 2024-06-11
C语言读写BMP文件-EasyBmp【 linux 平台】
**EasyBmp** 是一个49KB的轻量级C++图像处理库，专注于BMP格式，提供简单易用的API。它的特点是小巧、开源、易于理解和高度定制。通过示例代码展示了如何轻松读取、缩放和保存BMP图像。适合需要高效处理BMP图像的开发者。
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发表了文章 2024-06-11
【verilog】同步复位，异步复位以及异步复位同步释放
该文讨论了数字电路设计中触发器复位机制的三种类型：同步复位、异步复位和异步复位同步释放。同步复位在时钟边沿确保稳定性，但对复位脉冲宽度有要求；异步复位响应快速，但可能受干扰且时序不确定；异步复位同步释放则结合两者的优点。设计时需根据需求权衡选择。文中还给出了Verilog代码示例。
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发表了文章 2024-06-11
【学习笔记】Verilog之五：任务、函数及其他
在Verilog HDL中，任务（tasks）和函数（functions）增强了代码的可读性和重用性。任务是仅在仿真环境中使用的可封装代码，不可综合为硬件电路。任务定义包括标识符、输入/输出声明和实现代码，调用时需提供参数列表。函数与任务类似，但返回单个值，不包含时序控制，并且可以互相调用。函数定义包括返回值范围、输入声明、变量声明和执行代码。系统任务和函数如 `$display` 和 `$fopen` 提供了显示信息、文件I/O等便利功能，用于仿真控制和调试。禁止语句和命名事件则帮助控制代码执行和事件同步。
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发表了文章 2024-06-11
【学习笔记】Verilog之四：结构建模方法
Verilog 提供两种建模方法：行为建模和结构建模。行为建模专注于电路功能描述，类似高级编程语言，不涉及底层实现。数据流建模使用 `assign` 进行连续赋值，适合描述组合逻辑。线网可以在声明时直接赋值。顺序行为建模通过 `initial` 和 `always` 语句实现，`initial` 用于一次性初始化，`always` 则用于响应特定事件的重复执行。时序控制包括时延和事件控制，用于精确控制电路行为。阻塞和非阻塞赋值决定了语句执行的顺序和并发性。过程性连续赋值如 `assign-deassign` 和 `force-release` 提供了更多灵活性。
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发表了文章 2024-06-11
【学习笔记】Verilog之三：行为建模方法
Verilog是一种硬件描述语言，用于模拟电子系统的结构和行为。行为建模是Verilog的一种方法，分为数据流行为建模和顺序行为建模。 数据流行为建模主要使用`assign`语句，它描述了电路的功能而不涉及具体结构。连续赋值语句（`assign`）用于给线网分配值，当右端表达式发生变化时，新值会立即赋给线网。此外，还有时延的概念，可以指定赋值或事件发生的延迟时间。
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发表了文章 2024-06-11
【学习笔记】verilog HDL之二：数据类型与表达式
本文介绍了Verilog语言中的常量、变量和表达式。Verilog有四种基本值：0、1、x（未知）和z（高阻）。整型常量有十进制和基数两种格式，实数型常量包括浮点数，字符串常量由双引号括起的字符序列构成。变量分为线网型和寄存器型，线网型包括wire、tri等11种类型，寄存器型有reg、integer、time等，其中reg可声明存储器。表达式中的操作数包括常数、参数、线网等8种类型，操作符包括算术、关系、逻辑等9种类型。
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发表了文章 2024-06-11
初识 Verilog HDL , 什么是verilog HDL?
这是一篇关于Verilog HDL的学习笔记摘要。Verilog是一种硬件描述语言，用于数字系统的多层抽象设计，包括行为、数据流和结构。设计流程包括功能设计、Verilog描述、软件模拟、逻辑综合和硬件实现。模块是Verilog的基本单元，代表逻辑实体，通过并行运行和分层连接实现复杂系统。模块包含端口列表和定义，通过模块调用（实例化）实现子模块连接。Verilog的参数声明和预处理指令（如`define、`include和`timescale）增加了代码的可读性和灵活性。笔记指出Verilog与C语言有相似之处，易于学习。
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发表了文章 2024-06-11
Quartus II 中常见Warning 原因及解决方法
这篇内容是关于2010年作者在进行嵌入式FPGA开发时遇到的问题及解决方案的总结。主要问题包括时钟敏感信号在时钟边缘同时变化、信号截断、输出端口未使用、未定义的时钟信号、时钟延迟分析未启用、时序违规等。对应的解决措施涉及编辑vector source file、调整信号位数、添加约束信息、优化设计和设置时序要求等。此外，还包括对预发布设备时序特性的警告以及关于行波和门控时钟的注意事项。
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发表了文章 2024-06-11
关于数字电路中的“反馈”效应
这段内容是关于数字电路中组合电路的特性解释。组合电路的输出仅由当前输入决定，数据有效意味着稳定性，不随时间自发变化。因为无反馈，所以当输入不变时，输出保持稳定，适合进行基于当前输入的计算和逻辑操作。
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发表了文章 2024-06-11
石英晶体是如何产生振荡的？以及cpu倍频的由来
本文是关于石英晶体振荡器的学习笔记，适合计算机科学与技术背景的读者。内容涵盖了石英晶体振荡器的基本原理，包括压电效应、等效电路、谐振频率，以及不同类型振荡器的特性和参数。此外，还讨论了石英晶体振荡器的小型化、高精度、低噪声、低功耗发展趋势，并列举了它们在石英钟、彩电和通信系统中的应用。最后提到了处理器倍频的概念，解释了其原理和实际应用中的限制。
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发表了文章 2024-06-11
余三码和8421码的关系以及使用场景
余三码与8421码是两种不同的二进制编码方式，常用于表示十进制数。余三码是8421码加上3形成的无权码，具有自补性和进位信号特点，适合错误检测，但求和需修正。8421码是恒权码，方便二进制与十进制转换，常用于数字显示、数据传输和精确十进制运算。在计算机领域，两者各有应用场景，如BCD码用于七段显示器和精确计算，余三码则用于错误检测和简化算术操作逻辑设计。
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发表了文章 2024-06-11
C#.NET逃逸时间算法生成分形图像的毕业设计完成！晒晒功能
该文介绍了一个使用C#.NET Visual Studio 2008开发的程序，包含错误修复的Julia、Mandelbrot和优化过的Newton三种算法，生成色彩丰富的分形图像。作者改进了原始算法的效率，将内层循环的画点操作移至外部，提升性能。程序提供五种图形模式，支持放大缩小及颜色更新，并允许用户自定义画布大小以调整精度。还具备保存为高质JPG的功能。附有四张示例图片展示生成的分形效果。
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发表了文章 2024-08-01
倾斜摄影教程：无人机航拍后使用ContextCapture生成 3D模型
倾斜摄影建模利用多角度影像生成高精度三维模型，广泛应用于城市规划、遗产保护等领域。通过无人机拍摄与专业软件处理，实现真实感强、自动化程度高的实景建模。
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发表了文章 2025-07-02
项目介绍：InStock系统
InStock量化投资工具，支持多设备使用，提供数据获取、技术指标计算、K线形态识别、综合选股、策略验证与自动交易等功能，助力投资者高效决策。
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发表了文章
2025-09-26
完整教程：从0到1在Windows下训练YOLOv8模型
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发表了文章
2025-09-24
YOLOv11浅浅解析：架构创新
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2025-09-23
香烟品牌识别和规格识别设计思路
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2025-09-20
针对3-15分钟视频的抽帧策略：让Qwen2.5 VL 32B理解视频内容
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发表了文章
2025-09-17
【逆向】Python 调用 JS 代码实战：使用 pyexecjs 与 Node.js 无缝衔接
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2025-09-17
大盘择时：慎用固定均线！12年回测A股数据揭示择时策略的3大适应性缺陷
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2025-09-17
趋势跟踪 + 大盘择时：牛市收益放大器的终极指南
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2025-09-03
详细解释udp的传输过程（含多图）
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2025-09-03
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2025-09-02
Step-Audio2 声音克隆 详细介绍
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2025-08-18
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2025-07-02
项目介绍：基于ChartScanAI的crypto currency决策系统
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2025-07-02
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2025-02-08
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