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FPGA-（任务01）设计一个三位二进制减法计数器

2022-10-13 166
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简介： FPGA-（任务01）设计一个三位二进制减法计数器 
modulejianfaqi(
RST,//复位端CLK,//时钟输入端Q,//计数输出端    );
inputRST;
inputCLK;
outputreg [2:0]Q;
always@( posedgeCLKornegedgeRST )
beginif (RST==0)
Q<=3'b000;elseQ<=Q-1'b1;endendmodule

image.png

仿真的时序图：

image.png

文章标签：
FPGA云服务器
关键词：
FPGA云服务器计数器
FPGA云服务器任务
FPGA云服务器二进制计数器
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